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發布時間:2021-08-15 14:11  
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PCIe4.0推出后,不到2年就發布了PCIe5.0規范。根據市場的發展,對I/O帶寬的需求每三年就會翻一番,所以PCIe5.0是一個早就該有的規范。目前PCI-SIG的工作只是在補進度。得益于PCI-SIG的努力,今年5月正式推出了PCIe5.0規范,出現了很多設計插件,終端產品有望在2020年陸續推出。與PCIe4.0相比,PCIe5.0的性能提高了一倍,信號速率達到32Gb/s,單通道帶寬提高到32GB/2,x16帶寬提高到128GB/s,保持向后兼容(支持4.0~1.0)。
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現在,PCIe4.0的終端產品正在快速進入市場,而PCIe5.0的產品,也已推出,預期采用此規格的終端產品將于明年繼續推出,到2021年將有更多的產品被導入。不過,今年大的新聞,還是PCIe6.0草案0.3的發布,這一規范在今年十月份才發布。理查德·索洛蒙指出,新標準將把頻寬提高到更高的水平,信號速率達到64GT/s。
另外,不歸零(NRZ)傳輸技術也有了很大的發展,演變為四階脈沖幅度調變(PAM-4)。這一變化的主要原因是,NRZ在高速傳輸時,信號很容易衰減,而為了實現寬高頻傳輸,所以采用了PAM-4信號。因為PAM-4可以實現4種可能的電壓位準,每個符號代表2個位元,理論上PAM-4可以達到NRZ的兩倍速率。
現在PCIe3.0標準使用廣的實際上是10年前(2010年)制定的標準,而現在部分設備仍在使用的PCIe2.0標準,則更早地在2006年制定了。該PCIe2.0采用8b/10b的編碼方式,具有2.5GT/s的信號速率;該PCIe3.0采用128b/130b的編碼方式,信號速率增加到8GT/s;該PCIe4.0又一次翻番,達到16GT/s。因此就帶寬而言,當帶寬為16bit時,PCIe3.0是32GB/s,而PCIe4.0是64GB/s的兩倍。寬帶越大,吞吐量就越大,這意味著在同樣的時間內,傳輸的數據量也會越大。正如道路越寬,能同時通過的車輛就越多一樣。