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              線路板設計商擇優(yōu)推薦「多圖」

              發(fā)布時間:2020-11-16 06:58  

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              視頻作者:廣州俱進科技有限公司







              設計PCB電路板的10個簡單步驟


              如何設計PCB板并不容易。 其他工程師花了一些時間來學習PCB設計的技巧,您可以從他們的經驗中受益。 如果您不熟悉PCB設計,并且仍在學習線路板設計,我們已經整理了10個重要步驟,可用于為幾乎所有應用程序創(chuàng)建現代PCB布局。

              任何工程設計都有很多內容。 任何新的電子設備都將以框圖和/或一組電子原理圖開始。 原理圖完成并驗證后,您可以按照以下步驟在PCB設計軟件中創(chuàng)建現代PCB布局。 以下是PCB布局和設計步驟的完整列表:

              1,創(chuàng)建原理圖,

              2,創(chuàng)建空白的PCB布局

              3,原理圖捕獲:鏈接到您的PCB,

              4,設計PCB疊層

              5,定義設計規(guī)則和DFM要求,

              6,放置元件

              7,插入鉆孔,

              8,布線跟蹤

              9,添加標簽和標識符,

              10,生成設計文件






              17條PCB布局法則,輕松搞定80%以上的設計

              1、首先,我們會對結構有要求的器件進行擺放,擺放的時候根據導入的結構,連接器得注意1腳的擺放位置。

              2、布局時要注意結構中的限高要求。

              3、如果要布局美觀,一般按元件外框或者中線坐標來定位(居中對齊)。

              4、整體布局要考慮散熱。

              5、布局的時候需要考慮好布線通道評估、考慮好等長需要的空間。

              6、布局時需要考慮好電源流向,評估好電源通道。

              7、高速、中速、低速電路要分開。

              8、強電流、高電壓、強輻射元器件遠離弱電流、低電壓、敏感元器件。

              9、模擬、數字、電源、保護電路要分開

              10、接口保護器件應盡量靠近接口放置。

              11、接口保護器件擺放順序要求:(1)一般電源防雷保護器件的順序是:壓敏電阻、保險絲、抑制二極管、EMI濾波器、電感或者共模電感,對于原理圖缺失上面任意器件順延布局;(2)一般對接口信號的保護器件的順序是:ESD(TVS管)、隔離變壓器、共模電感、電容、電阻,對于原理圖缺失上面任意器件順延布局;嚴格按照原理圖的順序(要有判斷原理圖是否正確的能力)進行“一字型”布局。




              高速電路設計面臨的問題

              伴隨著半導體技術的快速發(fā)展,時鐘頻率越來越高。目前,超過一半的數字系統(tǒng)的時鐘頻率高于100MHz。另一方面,從半導體芯片封裝的發(fā)展來看,芯片體積越來越小、集成度越來越高、引腳數越來越多。所以,在當今的電路設計領域,電路系統(tǒng)正朝著大規(guī)模、小體積、高速度、高密度的方向飛速發(fā)展。這樣就帶來了一個問題,即芯片的體積減小導致電路的布局、布線很困難,而信號的頻率還在逐年增1高,邊沿速率越來越快,PCB上的電磁現象更復雜,適用于低速電路的電路理論知識(如基爾霍夫電壓/電流定律)可能已失去作用。此外,電子設備越來越廣泛地應用于人們的工作和生活之中,電子設備工作的電磁環(huán)境越來越復雜,電磁兼容問題也越來越重要。







              總之,電子技術的發(fā)展給高速數字系統(tǒng)設計帶來了挑戰(zhàn),作為高速電路設計的工程師,將不可避免地面臨一些新的問題。


              高速PCB設計中的阻抗匹配

              阻抗匹配阻抗匹配是指在能量傳輸時,要求負載阻抗要和傳輸線的特征阻抗相等,此時的傳輸不會產生反射,這表明所有能量都被負載吸收了。反之則在傳輸中有能量損失。在高速PCB設計中,阻抗的匹配與否關系到信號的質量優(yōu)劣。




              PCB走線什么時候需要做阻抗匹配?

              不主要看頻率,而關鍵是看信號的邊沿陡峭程度,即信號的上升/下降時間,一般認為如果信號的上升/下降時間(按10%~90%計)小于6倍導線延1時,就是高速信號,必須注意阻抗匹配的問題。導線延1時一般取值為150ps/inch。



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